VHDL是面向硬件的編程，和其他高級語言思路不太壹樣。VHDL語言要求對硬件要熟悉，知道代碼和硬件結構的對應關系，這樣才能寫出綜合結果較好的程序，比如綜合出來的電路邏輯門比較少。所以VHDL代碼不能隨意寫，有些符合語法規則的代碼有可能綜合出來壹個很壞的電路。
其它高級語言就沒有這樣的問題，只要符合語法，能實現功能，基本就可以接受了。
這有壹篇關於硬件描述代碼的文章建議看壹下，會有幫助的：/Blog/Detail_RD.Blog_Olive_2492.html
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