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FPGA如何采集OV7670的數據

應當先搞清楚OV7670的像素時鐘PCLK、行同步HREF、幀同步VSYNC三個信號與數據輸出D7~D0之間的時序關系,然後描述當VSYNC出現有效邊沿之後開始按照每個HREF有效(高電平)采集壹行數據(640個數據),采集時按照每個PCLK的上升沿壹次讀取D7~D0。每壹行有效數據640個,無效數據16個(在行消隱期間),每壹行花費時間為656個PCLK時鐘。當采集完480行的時候,就完成了壹幀數據的采集,幀消隱時間為8行數據的時間。因此采集壹幀數據的時間是656*488個像素的時間。

至於采集到的視頻數據存放在何處,這個由自己設計,可以放在自己設計的RAM中,也可以通過高速接口傳輸出去。

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