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- vhdl功能仿真和時序仿真的區別
vhdl功能仿真和時序仿真的區別
功能仿真只考慮電路模塊的邏輯功能是否達到設計要求,而不考慮器件的延遲;時序仿真則不僅考慮電路模塊的邏輯功能是否達到設計要求,還要考慮器件的延遲對電路模塊的影響。功能仿真僅對電路功能進行驗證,而時序仿真則對電路功能和性能同時進行驗證。所以對同壹個電路模塊而言,功能仿真時間比時序仿真時間要短。
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